IS42S16320B-7TL SDRAM 64Mb密度 166MHz速度 3.3V動作 16Mx16構成 LVTTLインターフェース 産業用温度（-40℃～85℃） コンパクトTSOP-IIパッケージ 高信頼性

IS42S16320B-7TL SDRAM 64Mb 密度 166MHz 速度 3.3V 動作 16Mx16 組織 LVTTL インターフェース 工業温度 (-40anddeg;C~85anddeg;C) コンパクト TSOP-II パッケージ 高信頼性

そして

特徴

時計周波数: 166, 143, 133 MHz

とbull; 完全同期; すべての信号は正の時計のエッジに参照

隠し行アクセス/プレチャージのための内部バンク

電気供給

そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして,そして

IS42/45S16320B 3.3Vandnbsp; そしてnbsp;3.3V

IS42S86400Band と と  3.3V と 3.3V

LVTTLインターフェイス

プログラム可能な波長とダッシュ (1, 2, 4, 8,全ページ)

プログラム可能な爆発配列: 連続/間隔

andbull; 自動更新 (CBR)

牛も 牛も 牛も 牛も

8Kリフレッシュサイクル 16ms (A2グレード) または 64ms (商業,産業,A1グレード)

とbull; ランダムな列アドレス毎クロックサイクル

andbull; プログラム可能なCAS遅延 (2,3時間)

andbull;バースト読み/書き込み,バースト読み/単一の書き込み操作の機能

andbull; 爆発停止と前充電コマンドによる爆発停止

andbull; 54ピンTSOP-IIと54ボールW-BGA (x16のみ) で利用可能

動作温度範囲:

商業用: 0°C から +70°C

工業用: -40°Cから+85°C

自動車用 A1: -40°Cから+85°C

自動車用 A2: -40°C から +105°C

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概要

ISSIand#39;の512Mb同期DRAMは,パイプラインアーキテクチャを使用して高速データ転送を達成する.すべての入力および出力信号は,クロック入力の高騰端を参照する.512MbのSDRAMは次のように構成されています..

そして

装置の概要

512Mb SDRAMは,高速 CMOS,動的ランダムアクセスメモリで,536,870912ビットで,内部は4つのDRAMで,それぞれ134ビットで,217x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,x8と134のそれぞれが,2178ビットで 8192行で 2048列に分けています.

512MbのSDRAMには,AUTO REFRESH MODEと省エネ,オフパワーモードが含まれています.すべての信号は,クロック信号のポジティブエッジ,CLKに登録されています.すべての入力と出力は LVTTL対応です.

512Mb SDRAMは,自動的な列アドレス生成により,高速なデータ速度でデータを同期的にバーストする能力を有する.内部バンク間を切り替える能力,プレチャージ時間を隠す能力,バーストアクセス中に各クロックサイクルで列のアドレスをランダムに変更する能力.

AUTO PRECHARGE 機能が有効になっている状態で,バーストシーケンス終了時に開始される自動タイムラインの予充電が可能です.他の3つの銀行の1つにアクセスしながら,前充電サイクルを隠し,シームレス提供します高速でランダムなアクセスです

SDRAMの読み書きアクセスは,選択した場所からスタートし,プログラムされたシーケンスでプログラムされた数々の場所で継続する.ACTIVE コマンドの登録はアクセスを開始します, その後は READ または WRITE コマンド. ACTIVE コマンドは,登録されたアドレスビットと併用して,アクセスされる銀行と行を選択するために使用されます (BA0,BA1,銀行を選択;A0-A12 行を選択)登録されたアドレスビットと組み合わせた READ または WRITE コマンドは,バーストアクセスのための開始列位置を選択するために使用されます.

プログラム可能な READ または WRITE バースト長さは 1, 2, 4 および 8 の位置またはフルページで構成され,バースト終了オプションがあります.

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記述

512MbのSDRAMは,3.3Vで動作し,同期インターフェース (すべての信号はクロック信号の正端 (CLK) に記録されます) を含む四つの銀行DRAMです.217728ビットバンクは 8,192行 × 1024列 × 16ビットまたは 8192行 × 2048列 × 8ビットに分かれています.

SDRAMへの読み書きアクセスはバースト指向で,アクセスは選択した位置から始まり,プログラムされた順序でプログラムされた数々の位置で継続する.アクセスは ACTIVE コマンドの登録から始まり,その後 READ または WRITE コマンドが続く.. ACTIVE コマンドと一致して登録されたアドレスビットは,アクセスされる銀行と行を選択するために使用されます (BA0 と BA1 は銀行を選択し,A0 A12 は行を選択します). アドレスビット A0-A9 (x16);A0-A9A11 (x8) と一致して登録された READ または WRITE コマンドは,バースト アクセスのためのスタート コラムの位置を選択するために使用されます.

SDRAMは通常動作する前に初期化されなければなりません.次のセクションでは,デバイス初期化,レジスタの定義,コマンドの説明と装置の操作.

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情報

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図面

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